A Novel Systolic Parallel Hardware Architecture for the FPGA Acceleration of Feedforward Neural Networks

  1. Medus, L.D.
  2. Iakymchuk, T.
  3. Frances-Villora, J.V.
  4. Bataller-Mompean, M.
  5. Rosado-Munoz, A.
Revista:
IEEE Access

ISSN: 2169-3536

Any de publicació: 2019

Volum: 7

Pàgines: 76084-76103

Tipus: Article

DOI: 10.1109/ACCESS.2019.2920885 GOOGLE SCHOLAR lock_openAccés obert editor
Font de les dades: Scopus